250. SRAM (Static RAM)

핵심 인사이트 (3줄 요약)

본질: SRAM (Static Random Access Memory)은 전원이 공급되는 한 데이터를 지속적으로 유지하는 쌍안정(Bistable) 플립플롭(Flip-Flop) 논리 게이트 기반의 초고속 휘발성 메모리다.

가치: 커패시터 충전/방전에 의존하는 DRAM과 달리, 전류의 흐름 자체로 0과 1을 유지하므로 주기적인 재충전(Refresh)이 필요 없어 **현존하는 반도체 메모리 중 가장 빠른 응답 속도(1ns 이하)**를 자랑한다.

융합: 그러나 1비트를 저장하는 데 6개의 트랜지스터(6T)가 필요하여 집적도가 낮고 가격이 비싸기 때문에, 메인 메모리로는 사용되지 못하고 오직 CPU 내부의 L1/L2/L3 캐시(Cache) 메모리라는 특수 목적 생태계를 독점하고 있다.

Ⅰ. 개요 및 필요성

개념: SRAM은 '정적(Static)'이라는 이름처럼, 데이터를 유지하기 위해 동적으로 무언가(Refresh)를 해줄 필요 없이 가만히 놔두어도 데이터가 보존되는 RAM이다. (단, 전원이 꺼지면 날아가는 휘발성이다.)
필요성: CPU 코어의 클럭 스피드가 수 GHz(나노초 단위)로 진입하면서, 데이터를 1나노초 이내에 CPU 입에 떠먹여 줄 초고속 버퍼 메모리가 절실해졌다. DRAM은 전자를 모으고 빼내는 데 수십 나노초가 걸려 파이프라인을 다 멈추게 만든다. 반면 SRAM은 전압 레벨로 스위치를 켜두는 즉각적인 논리 회로 방식이라 CPU와 1:1로 동일한 클럭 속도를 맞출 수 있는 유일한 메모리다.
💡 비유: DRAM이 물이 조금씩 새는 양동이라서 주기적으로 물(전기)을 계속 채워줘야(Refresh) 하는 번거로운 그릇이라면, SRAM은 한 번 스위치를 '똑딱' 켜두면 전기가 끊어지기 전까지는 완벽하게 그 상태를 유지하는 벽면 전등 스위치와 같습니다.
등장 배경: 1963년 로버트 노이스(Robert Noyce)가 고안한 최초의 집적 회로 메모리로, 트랜지스터의 상호 피드백 루프를 이용해 양안정 상태를 만들었다. 이후 1980년대 폰 노이만 병목이 심각해지자, CPU 칩 내부에 내장되는 캐시(Cache) 메모리의 표준 하드웨어 구현체로 영구적으로 채택되었다.

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│           SRAM과 DRAM의 1비트 저장 셀(Cell) 구조 비교 도식              │
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- **📢 섹션 요약 비유**: DRAM은 작은 컵 1억 개를 바닥에 깔아두고 물이 마르기 전에 계속 물을 부어줘야 하는 대규모 노가다 방식이고, SRAM은 튼튼한 금고 1천 개에 자물쇠를 걸어두고 필요할 때 즉시 열어보는 고급형 방식입니다.

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## Ⅱ. 아키텍처 및 핵심 원리

### 6T SRAM 셀의 읽기/쓰기 메커니즘

SRAM 셀은 6개의 트랜지스터로 구성되며, 4개는 데이터를 저장하는 양안정 래치(Latch)를 형성하고, 2개는 접근을 제어하는 액세스 트랜지스터다.

1. **대기(Standby) 상태**: 워드라인(WL)에 전압이 없으면 액세스 트랜지스터가 닫혀 있다. 내부 래치는 VDD와 GND 사이에서 누설 전류만 조금 흘리며 현재의 0 또는 1 상태를 무한 유지한다.
2. **읽기(Read) 동작**:
   - 두 개의 비트라인(`BL`과 `BL_bar`)을 VDD/2로 프리차지(Precharge)한다.
   - 워드라인(WL)을 켜면 셀이 비트라인과 연결된다.
   - 래치의 상태에 따라 한쪽 비트라인의 전압은 올라가고, 반대쪽은 내려간다.
   - 감지 증폭기(Sense Amplifier)가 이 미세한 전압 차이를 증폭하여 0인지 1인지 순식간에 판독한다.
3. **쓰기(Write) 동작**:
   - `BL`에 1, `BL_bar`에 0과 같은 강한 전압을 외부에서 걸어준다.
   - 워드라인을 열면, 외부의 강한 전압이 내부 래치의 기존 상태를 억지로 뒤집어버려 새로운 값으로 덮어쓴다.

### 면적(Area)과 레이턴시(Latency)의 트레이드오프

SRAM의 가장 큰 물리적 제약은 **면적**이다. 최신 CPU 칩의 레이아웃을 현미경으로 찍어보면, 전체 실리콘 면적의 무려 50% 이상을 L1/L2/L3 SRAM 캐시가 뒤덮고 있다. 코어(연산기) 자체는 작지만, 속도를 맞추기 위해 거대한 SRAM 밭을 깔아야만 하는 것이 현대 프로세서 설계의 딜레마다.

- **📢 섹션 요약 비유**: 빠르고 똑똑한 천재 한 명(SRAM)을 고용하려면 일반 직원 6명(DRAM) 치의 월급과 넓은 단독 사무실(면적)을 제공해야 합니다. 그래서 천재는 꼭 필요한 참모 자리(캐시)에만 소수로 배치하는 것입니다.

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## Ⅲ. 비교 및 연결

### SRAM vs DRAM 심층 구조 비교

| 비교 항목 | SRAM (Static RAM) | DRAM (Dynamic RAM) |
|:---|:---|:---|
| **저장 원리** | 트랜지스터 래치의 플립플롭 쌍안정 상태 | 커패시터의 전하 충전/방전 여부 |
| **셀 구성** | 6T (트랜지스터 6개) | 1T 1C (트랜지스터 1개, 커패시터 1개) |
| **재충전(Refresh)**| 불필요 (스스로 상태 유지) | 필수 (수 밀리초 단위로 방전되기 전 재충전) |
| **접근 속도** | ~ 1 ns (매우 빠름) | ~ 50 ns (SRAM 대비 수십 배 느림) |
| **집적도/용량** | 매우 낮음 (칩 하나에 수십 MB 한계) | 매우 높음 (칩 하나에 수십 GB) |
| **주요 용도** | CPU 내부 L1/L2/L3 캐시, 레지스터 파일 | 컴퓨터 메인 메모리, 그래픽 메모리 |

### 전력 소모의 양면성
SRAM은 리프레시 동작이 없기 때문에 과거에는 "저전력"으로 불렸다. 하지만 나노 공정 시대로 접어들면서, 6개의 트랜지스터에서 발생하는 **누설 전류(Leakage Current)**가 심각한 문제로 떠올랐다.
- DRAM은 동작할 때(Active) 전기를 많이 먹지만 가만히 있을 때는 전하만 가둬두면 된다.
- SRAM은 아무것도 안 하고 켜져만 있어도(Standby) 수천만 개의 6T 셀에서 전기가 줄줄 새어 나가므로(정적 전력 소모), 스마트폰 AP 등에서는 안 쓰는 캐시의 전원을 통째로 꺼버리는 파워 게이팅 기술이 필수적으로 결합된다.

- **📢 섹션 요약 비유**: SRAM은 모터가 계속 공회전하며 대기하는 스포츠카 같아서 언제든 즉시 튀어 나갈 수 있지만 기름(누설 전류)이 계속 닳습니다. 반면 DRAM은 시동을 껐다 켰다 해야 해서 출발은 느리지만 주차 중일 때의 연비는 훌륭합니다.

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## Ⅳ. 실무 적용 및 기술사 판단

### 실무 시나리오

1. **임베디드 IoT 디바이스의 메모리 선정**
   배터리 하나로 5년을 버텨야 하는 스마트 온도계 MCU(마이크로컨트롤러) 설계. 메인 메모리로 DRAM을 쓰면 낭패를 본다. DRAM은 데이터를 유지하기 위해 CPU가 자는 동안에도 끊임없이 리프레시 컨트롤러를 깨워 전력을 소모해야 한다. 초저전력 IoT 칩은 용량이 수백 KB로 작더라도 **메인 메모리 전체를 SRAM으로 구성**한다. 그러면 CPU가 슬립 모드에 들어갔을 때 리프레시 없이 최소한의 대기 전압만으로 데이터를 보존할 수 있어 배터리 수명을 극대화할 수 있다.

2. **고성능 라우터/스위치의 패킷 버퍼 설계**
   400Gbps로 쏟아지는 네트워크 패킷을 라우팅 테이블과 대조하여 즉시 스위칭해야 하는 최상위 통신 장비. 패킷 라우팅은 완벽한 랜덤 액세스(Random Access)의 극치다. IP 주소가 사방으로 튀기 때문에 캐시의 '지역성' 혜택을 전혀 받지 못한다. 만약 패킷 버퍼를 DRAM으로 만들면 랜덤 접근 시 발생하는 RAS-to-CAS 딜레이 때문에 패킷이 모조리 드랍된다. 통신 장비 벤더는 가격이 천문학적이더라도 대용량의 **전용 QDR SRAM (Quad Data Rate SRAM)**을 박아 넣어 지연 시간 없는 패킷 스위칭을 달성한다.

3. **CPU L3 캐시 용량 한계 돌파 (AMD 3D V-Cache)**
   게임 성능을 위해 CPU L3 캐시 용량을 32MB에서 96MB로 늘리고 싶은데, 실리콘 다이 옆으로 펼치자니 칩 면적이 너무 커져 수율이 망가지는 상황. SRAM 6T 셀의 물리적 크기는 아무리 공정을 미세화해도 한계가 있다. AMD는 칩을 가로로 늘리는 대신, 수직으로 쌓아 올리는 TSV(실리콘 관통 전극) 3D 패키징 기술을 도입했다. CPU 코어 위에 **SRAM 캐시 타일을 아파트 2층처럼 통째로 얹어서** 면적 패널티 없이 용량을 3배로 뻥튀기했고, 이는 캐시 미스에 민감한 게이밍 벤치마크에서 압도적인 프레임 상승효과를 가져왔다.

### 안티패턴
- **단일 포트(Single-Port) SRAM으로 듀얼 코어 동시 접근 허용**: 두 개의 파이프라인이나 스레드가 동시에 1포트 SRAM의 같은 블록에 R/W를 시도하면 필연적으로 구조적 충돌(Stall)이 발생한다. 고성능 레지스터 파일이나 L1 캐시를 설계할 때는 트랜지스터를 더(8T, 10T) 부어서라도 **다중 포트(Multi-port) SRAM**으로 설계하여 동시 읽기/쓰기를 하드웨어적으로 보장해야 한다.

- **📢 섹션 요약 비유**: 좁은 땅에 창고(SRAM)를 지을 때, 무작정 창고를 가로로 넓히면 땅값이 감당이 안 되니(수율 저하), 대신 2층, 3층으로 건물을 올려(3D 패키징) 좁은 공간에서도 많은 짐을 보관하는 것이 최신 건축 트렌드입니다.

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## Ⅴ. 기대효과 및 결론

### 기술 진화와 미래 전망
- **SRAM 공정 미세화의 벽**: 무어의 법칙이 3nm, 2nm로 접어들고 있지만, 논리 게이트는 줄어들어도 6개의 트랜지스터가 얽힌 SRAM 셀은 아날로그적 물리 특성 때문에 면적 축소율이 한계에 부딪혔다(SRAM Scaling Wall).
- **대체 기술 MRAM / STT-MRAM**: SRAM의 막대한 면적과 누설 전류를 극복하기 위해, 트랜지스터 대신 자성체의 스핀(Spin) 방향으로 0과 1을 저장하는 MRAM이 차세대 캐시로 연구되고 있다. MRAM은 비휘발성이라 전원이 꺼져도 유지되며, 구조가 단순해 SRAM 수준의 속도를 내면서도 면적은 절반 이하로 줄일 수 있는 궁극의 메모리다.

### 결론
SRAM(Static RAM)은 무식하지만 가장 확실하게 속도를 담보하는 하드웨어 설계의 승리다. 6개의 트랜지스터를 낭비(?)해서라도 커패시터의 충/방전 지연을 없애버렸고, 그 대가로 얻어낸 1 나노초의 응답 속도는 현대 컴퓨터 구조의 심장인 파이프라인과 캐시 계층을 유지하는 최후의 보루가 되었다. 미래에 대체 소자가 등장하기 전까지, 실리콘 기반 아키텍처에서 "가장 빠른 것은 결국 6T 플립플롭이다"라는 명제는 흔들리지 않을 것이다.

- **📢 섹션 요약 비유**: SRAM은 마차(DRAM) 시대에 홀로 발명된 순간이동 장치입니다. 비록 만드는 데 돈이 수백 배 들고 부피가 커서 집집마다 놓진 못하지만, 가장 중요하고 긴급한 물건을 나르는 데는 결코 포기할 수 없는 마법의 인프라입니다.

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### 📌 관련 개념 맵

| 개념 명칭 | 관계 및 시너지 설명 |
|:---|:---|
| **DRAM** | SRAM과 대척점에 있는 대용량/고집적 메모리로, 둘의 단점을 서로 상호 보완하는 메모리 계층 구조를 형성함. |
| **캐시 메모리** | SRAM의 초고속 특성을 활용하여 CPU 칩 내부에 내장되는 임시 데이터 보관소. |
| **플립플롭** | SRAM이 데이터를 기억하기 위해 사용하는 쌍안정(Bistable) 논리 회로. |
| **누설 전류** | 6개의 트랜지스터가 항상 켜져 있어야 하는 SRAM이 미세 공정에서 직면한 최악의 전력 낭비 문제. |
| **파워 게이팅** | SRAM 캐시의 누설 전류를 막기 위해, 사용하지 않는 캐시 블록의 전원을 OS 레벨에서 완전히 차단하는 기술. |

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### 👶 어린이를 위한 3줄 비유 설명
1. 컴퓨터 안에는 기억을 담당하는 두 명의 일꾼이 있어요. 한 명은 '램(DRAM)'이고 다른 한 명은 '스램(SRAM)'이에요.
2. 램은 기억력이 나빠서 1초마다 누가 옆에서 "잊어버리지 마!" 하고 계속 잔소리를 해줘야 간신히 기억을 유지하는 바보지만, 아주 많은 걸 외울 수 있어요.
3. 하지만 스램은 한 번 머릿속에 넣으면 절대 까먹지 않는 천재라서 잔소리가 필요 없어요! 그래서 엄청나게 빨리 대답할 수 있는 대신, 천재라서 몸값이 너무 비싸 아주 조금만 쓴답니다.